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LVDS测试,LVDS检测,信号完整性测试

更新:2024-04-19 07:28 发布者IP:45.251.21.202 浏览:2次
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LVDS测试,LVDS检测,信号完整性测试
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LVDS测试,LVDS检测,信号完整性测试

屏幕参数的相关设置(蓝色部分)

fb_videomode各个参数的意义

各参数的抽象如下图所示:

关于fb_videomode各个成员的意义详解:

名称

数据手册中的简称

中文名

意义

备注

(简称或另名称)

name

No

名字

液晶屏名字(可选)

No

refresh

刷新频率

刷新频率(内核中很多例子都赋值为60)

xres

行宽

每行的像素个数

yres

屏幕高度

屏幕的行数

pixclock

像素时钟

每个像素时钟周期的长度,单位是皮秒(10的负12次方分之1秒)

left_margin

HBP

水平后沿

在每行或每列的象素数据开始输出时要插入的象素时钟周期数

right_margin

HFP

水平前沿

在每行或每列的象素结束到LCD 行时钟输出脉冲之间的象素时钟数

upper_margin

VBP

垂直后沿

在垂直同步周期之后帧开头时的无效行数

lower_margin

VFP

垂直前沿

本帧数据输出结束到下一帧垂直同步周期开始之前的无效行数

hsync_len

HPW

行同步脉宽

单位:像素时钟周期

HWH(HSYNC width)

vsync_len

VPW

垂直同步脉宽

单位:显示一行的时间th

sync

同步极性设置

可以根据需要设置FB_SYNC_HOR_HIGH_ACT(水平同步高电平有效)和FB_SYNC_VERT_HIGH_ACT(垂直同步高电平有效)

vmode

No

 在内核中的大多数示例都直接置为FB_VMODE_NONINTERLACED。interlaced的意思是交错[隔行]扫描,电视中使用2:1的交错率,即每帧分两场,垂直扫描两次,一场扫描奇数行,另一场扫描偶数行。很显然LCD目前不是这种模式。

flag

目前没有看到用法

 

由上图可得:

水平总周期 = left_margin + right_margin + hsync_len

垂直总周期 = upper_margin + lower_margin + vsync_len

下面主要以16BPP的TFT屏作为例子。有的LCD会给出参数列表,比如下图,可以很清楚的在红框中找到需要的参数,取“type”典型值即可。但是有的LCD并没有直接给出这样的列表,设置某些参数没有给出,这需要通过时序图来确定。

D0BB1430-7FF6-49FA-B873-29F085FC493D.png D0BB1430-7FF6-49FA-B873-29F085FC493D.png

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法定代表人邓桂才
注册资本100
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主营产品高速电路测试服务;仪器仪表租售
经营范围租赁仪器仪表、建筑工程机械设备;维修机械设备、仪器仪表;销售计算机、软硬件及辅助设备、机电设备、仪器仪表、通讯设备、文化用品、电子产品、金属材料、金属制品、五金交电、建筑材料、装饰材料、塑料制品、工艺品、汽车配件、电子元器件;货物进出口、技术进出口、代理进出口。(企业依法自主选择经营项目,开展经营...
公司简介北京淼森波信息技术有限公司(MISENBO)成立于2015年,是一家技术服务型公司,即为中小型、初创型企业提供硬件开发配套服务和硬件测试服务。主要业务有:高速电路测试服务和仪器仪表租售业务。高速电路测试服务项目有:①SI信号完整性测试,主要内容是电源上电时序、复位、时钟、I2C、SPI、Flash、DDR、JTAG接口、CPLD接口测试、URAT测试、网口测试、USB2.0/USB3.0测试、MI ...
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